Stage 2026-Optimisation des stratégies de test mémoire pour systèmes électroniques embarqués H/F AIRBUS

**Job Description:**

Lieu : Airbus Defence and Space - Élancourt (Région Parisienne)

*Durée : 6 mois *

Démarrage : À partir de janvier 2026 (date adaptable)

Rejoindre Airbus Defence and Space, c'est...

Intégrer Airbus, c'est travailler au cœur d'un leader mondial de l'aéronautique et du spatial, dans un environnement international et innovant. Vous évoluerez dans une entreprise tournée vers le digital, la recherche et les technologies de pointe, avec la possibilité de contribuer à des projets spatiaux de grande envergure.

*Votre mission*

Au sein du département Validation-IVVQ , vous participerez à la qualification et à* la validation des équipements électroniques pour satellites*. Encadré(e) par un tuteur expérimenté, vous serez impliqué(e) dans toutes les étapes du projet, de la mise au point à la validation, avec une vraie marge d'initiative.

A partir d'une analyse bibliographique des structures internes des composants mémoires tels que les SRAM, DDR, FLASH NAND, FLASH NOR, MRAM, l'objectif est d'établir une liste des défauts potentiels.

Dans un second temps, une analyse bibliographique des algorithmes de tests utilisés par les fondeurs, les industriels permettra d'établir une liste des algorithmes permettant de détecter les défauts potentiels des composants.

A partir de ces 2 listes, des choix adaptés aux solutions mémoires mises en œuvre sur les cartes électroniques spatiales seront réalisés pour développer et coder ces algorithmes de tests embarqués dans nos calculateurs et nos mémoires de masse de nouvelle génération.

Le codage des algorithmes sera réalisé sur la base de cartes embarquant des processeurs ARM.

* Vos principales responsabilités : *

• Analyser et documenter les différents types de mémoires électroniques (FLASH, DDR5, MRAM, ....)

• Analyser et documenter les différents types de défaillances des composants mémoires (Collage à 0, Circuit Ouvert, Collage inter cellule, ...)

• Analyser et documenter les différents types de codes correcteurs embarqués dans les FPGA pour les mémoires (Reed Solomon, EDAC, Parité, ...)

• Analyser et documenter les différents types d'algorithme de tests des mémoires (March C, Marinescu, Checker Board, test de Hammer...)

• Sélectionner les tests à réaliser selon l'implémentation des mémoires sur une carte électronique spatiale

• Développer du code C pour réaliser les algorithmes identifiés

• Analyser, définir des modules de tests dans des FPGA

*Ce que vous allez apprendre et développer*

• connaissance des technologies de composants électroniques

• validation d'électronique spatiale,

• codage en C ou en python d'algorithme de tests

• contraintes d'utilisation des mémoires dans un environnement sévère.

Vous approfondirez votre vue globale des processus nécessaires au développement des projets.

• Connaissance du Langage C, Python

• Connaissance du VHDL

• Connaissances en électronique numérique et analogique

Compétences de travail en équipe dans un environnement international.

Votre profil

Vous préparez un diplôme *Bac+5* * (école d'ingénieur ou université) en électronique* ou domaine proche.
Vous disposez de :

* Bonnes connaissances en électronique analogique et numérique.

* Compétences en langage C et Python.

* Esprit d'analyse, autonomie, curiosité et goût du travail en équipe



Langues :

* Français courant

* Anglais intermédiaire minimum



Prêt(e) à embarquer ?

Ce stage est une opportunité unique de contribuer à l'avenir du spatial tout en développant des compétences techniques et humaines précieuses.

Rejoignez-nous pour participer aux innovations qui feront avancer l'exploration spatiale

This job requires an awareness of any potential compliance risks and a commitment to act with integrity, as the foundation for the Company's success, reputation and sustainable growth.

****Company:****
Airbus Defence and Space SAS

*Employment Type:*
Internship
-------

*Experience Level:*
Student

*Job Family:*
Testing

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